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2Gb: x16, x32 Mobile LPDDR2 SDRAM S4
Burst WRITE Command
Figure 39: Data Input (WRITE) Timing
DQS
DQS#
t WPRE
DQS#
DQS
V IH(AC)
t DQSH
V IH(DC)
t DQSL
V IH(AC)
V IH(DC)
t WPST
DQ
D IN
D IN
D IN
D IN
V IL(AC)
t DS
t DH
V IL(DC)
V IH(AC)
t DS
t DH
V IL(AC)
V IH(DC)
t DS
t DH
V IL(DC)
V IH(AC)
t DS
t DH
V IH(DC)
DM
V IL(AC)
V IL(DC)
V IL(AC)
V IL(DC)
Don’t Care
Figure 40: Burst WRITE – WL = 1, BL = 4
T0
T1
T2
T3
T4
Tx
Tx + 1
Ty
Ty + 1
CK#
CK
WL = 1
CA[9:0]
Bank n
col addr
Col addr
Bank n
Bank n
row addr
Row addr
CMD
WRITE
NOP
NOP
NOP
NOP
PRECHARGE
NOP
ACTIVATE
NOP
Case 1: t DQSSmax
t DQSSmax
t D S S
t D S S
Completion of burst WRITE
DQS#
DQS
t WR
DQ
D IN A0
D IN A1
D IN A2
D IN A3
Case 2: t DQSSmin
t DQSSmin
t DSH
t DSH
t RP
DQS#
DQS
t WR
DQ
D IN A0
D IN A1
D IN A2
D IN A3
Transitioning data
PDF: 09005aef83f3f2eb
2gb_mobile_lpddr2_s4_g69a.pdf – Rev. N 3/12 EN
63
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